当GATE和BACKGATE之间的电压差小于阈值电压时，不会形成channel。当电压差超过阈值电压时，channel就出现了。MOS电容：（A）未偏置（VBG=0V），（B）反转（VBG=3V），（C）积累（VBG=-3V）。正是当MOS电容的GATE相对于backgate是负电压时的情况。电场反转，往表面吸引空穴排斥电子。硅表层看上去更重的掺杂了，这个器件被认为是处于accumulation状态了。MOS电容的特性能被用来形成MOS管。Gate，电介质和backgate保持原样。在GATE的两边是两个额外的选择性掺杂的区域。其中一个称为source，另一个称为drain。假设source和backgate都接地，drain接正电压。只要GATE对BACKGATE的电压仍旧小于阈值电压，就不会形成channel。Drain和backgate之间的PN结反向偏置，所以只有很小的电流从drain流向backgate。如果GATE电压超过了阈值电压，在GATE电介质下就出现了channel。这个channel就像一薄层短接drain和source的N型硅。由电子组成的电流从source通过channel流到drain。总的来说，只有在gate对source电压V超过阈值电压Vt时，才会有drain电流。

    这就提出一个要求，需要使用一个电路，让低压侧能够***控制高压侧的MOS管，同时高压侧的MOS管也同样会面对1和2中提到的问题。在这三种情况下，图腾柱结构无法满足输出要求，而很多现成的MOS驱动IC，似乎也没有包含gate电压限制的结构。于是我设计了一个相对通用的电路来满足这三种需求。mos管工作原理图如下：用于NMOS的驱动电路用于PMOS的驱动电路NMOS驱动电路做一个简单分析Vl和Vh分别是低端和的电源，两个电压可以是相同的，但是Vl不应该超过Vh。Q1和Q2组成了一个反置的图腾柱，用来实现隔离，同时确保两只驱动管Q3和Q4不会同时导通。R2和R3提供了PWM电压基准，通过改变这个基准，可以让电路工作在PWM信号波形比较陡直的位置。Q3和Q4用来提供驱动电流，由于导通的时候，Q3和Q4相对Vh和GND低都只有一个Vce的压降，这个压降通常只有，低于。R5和R6是反馈电阻，用于对gate电压进行采样，采样后的电压通过Q5对Q1和Q2的基极产生一个强烈的负反馈，从而把gate电压限制在一个有限的数值。这个数值可以通过R5和R6来调节。后，R1提供了对Q3和Q4的基极电流限制，R4提供了对MOS管的gate电流限制，也就是Q3和Q4的Ice的限制。必要的时候可以在R4上面并联加速电容。

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